MOTOROLA MVME172PA-644L

LANC中斷

MC2芯片為普通LANC提供中斷控制寄存器

lan的總線錯誤終止和另一個寄存器

操作。MC2芯片請求在編程的水平上中斷

如果中斷被啟用，LANC中斷控制寄存器

在82596CA INT*引腳或LANC總線上檢測到正邊

檢測到錯誤條件。

53C710 SCSI控制器接口

MC2芯片提供了映射解碼器和中斷處理程序

NCR 53C710 SCSI I/O處理器。53C710的基址為

FFF47000美元。MC2芯片在編程的級別請求中斷

在SCSI中斷控制寄存器，如果中斷是啟用和低

在53C710的IRQ*引腳上檢測電平。

SRAM存儲器控制器

SRAM的基址和大小是可編程的。SRAM的

控制器設(shè)計用于100 ns設(shè)備的操作。的大小

SRAM是在DRAM/SRAM選項寄存器中初始化的

MVME172復(fù)位。SRAM在25mhz時的性能為5,3,3,3，用于讀和

寫周期。33 MHz的SRAM性能為6,4,4,4，用于讀取周期和

寫周期為6,3,3,3。

非ecc DRAM內(nèi)存控制器

當(dāng)DRAM為非ecc時，由MC2芯片ASIC決定

表演本節(jié)將介紹這種情況下的DRAM選項。

DRAM的基址和陣列大小是可編程的。DRAM是

如果大小為16MBytes且非，則配置為交錯數(shù)組

如果大小為4或8mb，則為交錯。

奇偶校驗和奇偶異常動作也是可編程的。的

在初始化DRAM陣列大小和DRAM設(shè)備大小時

DRAM/SRAM選項寄存器。

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3-6計算機組文獻中心網(wǎng)站

MC2芯片

3.

說明TEA是MC68060總線的錯誤事務(wù)信號?！?/p>

“TEA”表示DRAM發(fā)生總線錯誤周期

發(fā)現(xiàn)奇偶校驗錯誤。

Z85230 SCC接口

MC2芯片為兩者提供了映射解碼器和中斷處理程序

Zilog Z85230s。基本地址為$FFF45000和$FFF45800。的

MC2芯片請求在SCC中編程的電平中斷

中斷控制寄存器，如果中斷被啟用并且低電平是

在SCC INT*引腳上檢測。Z85230提供中斷向量

對于中斷確認(rèn)周期。在中斷確認(rèn)期間

周期中，來自第一個Z85230的中斷比來自第二個Z85230的中斷具有優(yōu)先級

第二個Z85230。

MC2芯片支持多達4個Z85230器件。(有兩個

MVME172上的z85230。參考板級硬件

MVME172安裝和使用手冊中的描述。)的

表3 - 1。DRAM性能

時鐘預(yù)算運行條件

4,2,2,2非交錯，可讀，25mhz，在奇偶校驗錯誤上沒有TEA

4,1,1,1交錯，讀取，25mhz，在奇偶校驗錯誤上沒有TEA

5,3,3,3非交錯，讀取，25mhz，在奇偶校驗錯誤上具有TEA

5,2,2,2交錯，讀取，25mhz，在奇偶校驗錯誤上具有TEA

3,2,2,2寫入，25mhz

5,3,3,3非交錯，讀，32 MHz，在奇偶校驗錯誤上沒有TEA

5,2,2,2交錯，讀取，32 MHz，在奇偶校驗錯誤上沒有TEA

6,4,4,4非交錯，讀取，32 MHz，在奇偶校驗錯誤上具有TEA

6,3,3,3交錯，讀取，32 MHz，在奇偶校驗錯誤上具有TEA

4,2,2,2寫，32mhz以上翻譯結(jié)果來自有道神經(jīng)網(wǎng)絡(luò)翻譯（YNMT）· 通用場景

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